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IRFPA非均匀性校正系统中的关键电路设计

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摘要介绍了一种焦平面阵列探测器非均匀性的多点实时校正系统,该系统具有校正精度高、易于实现、实时性强等优点.同时介绍了该系统中的重要逻辑模块--12bit×8bit乘法器的VHDL设计,该乘法器占用FPGA硬件资源少,运行实时性好.

DOI lj1e1xz5dv/399344

作者周冰;王永仲;何永强

机构地区不详

出处《军械工程学院学报》 2005年6期

关键词非均匀性校正 FPGA 乘法器 VHDL

分类 [兵器科学与技术][武器系统与运用工程]

出版日期 2005年06月16日（中国期刊网平台首次上网日期，不代表论文的发表时间）

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